什么是模块施工 江苏芯钻时代电子科技供应

整流桥模块特点：

3、电力半导体芯片：超快恢复二极管(FRED)和晶闸管(SCR)芯片的PN结是玻璃钝化保护，并在模块制作过程中再涂有RTV硅橡胶，并灌封有弹性硅凝胶和环氧树脂，这种多层保护使电力半导体器件芯片的性能稳定可靠。半导体芯片直接焊在DBC基板上，而芯片正面都焊有经表面处理的钼片或直接用铝丝键合作为主电极的引出线，而部分连线是通过DBC板的刻蚀图形来实现的。根据三相整流桥电路共阳和共阴的连接特点，FRED芯片采用三片是正烧(即芯片正面是阴极、反面是阳极)和三片是反烧(即芯片正面是阳极、反面是阴极)，并利用DBC基板的刻蚀图形，使焊接简化。同时，所有主电极的引出端子都焊在DBC基板上，这样使连线减少，模块可靠性提高。

    脉冲的幅值与栅驱动电路阻抗和dV/dt的实际数值有直接关系。IGBT本身的设计对减小C和C的比例非常重要，它可因此减小dV/dt感生电压幅值。如果dV/dt感生电压峰值超过IGBT的阀值，Q1产生集电极电流并产生很大的损耗，因为此时集电极到发射极的电压很高。为了减小dV/dt感生电流和防止器件开通，可采取以下措施：关断时采用栅极负偏置，可防止电压峰值超过V，但问题是驱动电路会更复杂。减小IGBT的CGC寄生电容和多晶硅电阻Rg’。减小本征JFET的影响图3给出了为反向偏置关断而设计的典型IGBT电容曲线。CRES曲线（及其他曲线）表明一个特性，电容一直保持在较高水平，直到V接近15V，然后才下降到较低值。如果减小或消除这种“高原”(plateau)特性，C的实际值就可以进一步减小。这种现象是由IGBT内部的本征JFET引起的。如果JFET的影响可以**小化，C和C可随着VCE的提高而很快下降。这可能减小实际的CRES，即减小dV/dt感生开通对IGBT的影响。图3需负偏置关断的典型IGBT的寄生电容与V的关系。IRGP30B120KD-E是一个备较小C和经改良JFET的典型IGBT。这是一个1200V，30ANPTIGBT。它是一个Co-Pack器件，与一个反并联超快软恢复二极管共同配置于TO-247封装。设计人员可减小多晶体栅极宽度。

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